Universitat Rovira i Virgili

Activitat esportiva

DEIMinari: Semidynamics: Diseñando AI hardware en Barcelona

Sala de graus ETSE

12:00 h

Títol: Semidynamics: Diseñando AI hardware en Barcelona

Conferenciant: Pedro Marcuello Pascual

Institució: Semidynamics

Professor/a organitzador/a: Carlos María MOLINA CLEMENTE

Hora: 13:00h

Resum:

En esta charla presentaré Semidynamics, una empresa netamente catalana, con sede en Barcelona y donde buscamos ingenieros de hardware, y también, ingenieros de software que les guste el saber cómo se ejecuta el código dentro del procesador y pensar qué se podría hacer para conseguir que se ejecute más rápido. También hablaré del ciclo de diseño de IP y de los productos actuales que Semidynamics ofrece en el mercado, los cores RISC-V Avispado y Atrevido, así como los aceleradores vectoriales y tensoriales, que han sido la llave para la explosión de la inteligencia artificial. Pedro Marcuello empezó a estudiar Ingeniería Informática (entonces Licenciatura) en la Facultad de Informática de Barcelona (UPC) en 1990, y desde muy al principio le gustaron asignaturas relacionadas más con el hardware y los sistemas que las clásicas de programación. Tras conseguir el Master en Ingeniería Informática en 1995, hizo el doctorado en Arquitectura y Tecnología de Computadores y consiguió el título de Doctor en el 2003 mientras compaginaba el doctorado con la docencia en la universidad. A pesar de que trabajar de arquitecto de computadores en este país parecía algo imposible más allá de la investigación y dar clases en la Universidad, tras el Doctorado, Pedro trabajó para Intel Corporation en Barcelona desde el 2003 hasta el año 2014 haciendo tareas de investigación para Intel Labs. Tras ello, Pedro trabajó del 2014 al 2016 en Broadcom en el desarrollo de un multiprocesador ARMv7-v8 encargándose de las unidades de coma flotante y las unidades SIMD. Tras un año trabajando en FPGAs, Pedro se unió a Semidynamics en Enero del 2018 donde actualmente es Fellow Engineer y ha participado en el diseño arquitectónico y desarrollo de los cores RISC-V Avispado y Atrevido, y de las unidades vectorial y tensorial.


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